ALU에서 수행되는 산술연산은 병렬 가산기를 기본으로 구현된다. [ 그림 6-24 ]는 4비트 병렬 가산기를 나타낸 것으로 4개의 전가산기(FA)로 구성된다.

[ 그림 6-24 ]

병렬 가산기가 단순한 덧셈 기능뿐만 아니라 여러 가지 연산을 수행하려면 구성 요소인 전가산기의 한쪽 입력단자에 논리회로를 추가해야 한다. [ 그림 6-25 ]는 전가산기의 한 입력에 논리회로를 추가하여서 두 개의 선택 신호 S1과 S0 그리고 자리 올림 C1에 의해서 여덟 가징 연산을 수행할 수 있는 전가산기 회로를 나타낸 것이다. 또한 S1과 S0가 입력 B1 값을 결정하게 된다.

[ 그림 6-25 ]

선택 신호 S1과 S0 그리고 자리 올림 Ci에 의해서 수행되는 8개의 연산을 고려해보자.

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[ 표 6-1 ] 은 산술연산에 함수 테이블을 나타낸 것이다. 철 번째와 마지막은 동일한 연산이다.

[ 표 6-1 ]